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Des chercheurs créent un prototype de puce de contrôle 2T1R pour l'informatique neuromorphique

Macro-prise de vue d'une plaquette de silicium - des structures comme celles-ci sont à la base des puces utilisées dans l'informatique neuromorphique et en mémoire (Source de l'image : Laura Ockel via Unsplash)
Macro-prise de vue d'une plaquette de silicium - des structures comme celles-ci sont à la base des puces utilisées dans l'informatique neuromorphique et en mémoire (Source de l'image : Laura Ockel via Unsplash)
Une nouvelle architecture basée sur les memristors 2T1R vise à permettre un calcul en mémoire à faible consommation pour l'IA et les dispositifs de pointe. La conception intègre la régulation du courant et la compatibilité CMOS pour prendre en charge les tâches analogiques VMM et neuromorphiques.

Et si votre disque dur pouvait penser avec vos données ? Au lieu de simplement stocker des fichiers, imaginez qu'il traite les informations et y répond exactement là où elles sont conservées. C'est le principe de l'informatique en mémoire, une évolution croissante de l'architecture qui rapproche la logique de la mémoire pour améliorer l'efficacité.

Des chercheurs du Forschungszentrum Jülich et de l'université de Duisburg-Essen ont présenté une nouvelle conception basée sur les memristors 2T1R qui pourrait prendre en charge ce changement et permettre une IA et un matériel de pointe plus efficaces sur le plan énergétique.

Publiée sur arXivla conception intègre deux transistors et un memristor par cellule, avec une régulation du courant destinée à supprimer les courants de cheminement furtif, un défi connu dans les réseaux de memristors. Contrairement à la mémoire conventionnelle, la conception proposée met à la terre les deux bornes du memristor lorsqu'elles sont inactives - une stratégie qui peut contribuer à améliorer la stabilité du signal et à réduire les fuites.

L'architecture est conçue pour prendre en charge la multiplication vectorielle matricielle analogique (VMM), une fonction essentielle de l'apprentissage automatique, en contrôlant la conductance des memristors à l'aide de CNA intégrés, de signaux PWM et de circuits de courant régulés. Un réseau de test 2×2 a été mis en œuvre avec succès en utilisant la technologie CMOS standard 28 nm.

En s'attaquant aux problèmes de masse virtuelle et aux effets de résistance des fils, l'architecture vise à améliorer la prévisibilité des performances et à réduire la consommation d'énergie. Compatible avec le contrôle RISC-V et l'interface numérique, la conception 2T1R pourrait jeter les bases de puces neuromorphiques évolutives, permettant une accélération de l'IA plus rapide et plus compacte directement dans la mémoire.

Votre disque dur n'est peut-être pas encore en train de penser, mais l'architecture qui sous-tend cette vision prend déjà forme dans le silicium, laissant entrevoir un avenir d'IA plus rapide et intégrée à la mémoire.

Pour obtenir tous les détails techniques et les résultats, consultez la prépublication arXiv complète de (PDF).

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Louise Burke, 2025-05-21 (Update: 2025-05-22)